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数字逻辑(第3版)

数字逻辑(第3版)

作者: 詹瑾瑜 主编;江维,李晓瑜 编著

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已完结现代当代当代文学
目录 (224章)
倒序
正文
001 数字逻辑基础002 .1 概述003 .1.1 数字逻辑研究的对象及方法004 .1.2 数字电路的发展005 .1.3 数字电路的分类006 .2 数制及其转换007 .2.1 进位计数制008 .2.2 数制转换009 .3.1 原码及其运算010 .3.2 反码及其运算011 .3.3 补码及其运算012 .3.4 符号位扩展013 .4 数的定点与浮点表示014 .5 数码和字符的编码015 .5.1 BCD编码016 .5.2 可靠性编码017 .5.3 字符编码018 .6 本章小结019 .7 习题020 逻辑代数基础021 .1 逻辑代数的基本概念022 .1.1 逻辑代数的定义023 .1.2 逻辑代数的基本运算024 .1.3 逻辑代数的复合运算025 .1.4 逻辑函数的表示法和逻辑函数的关系026 .2 逻辑代数的基本定律、规则和常用公式027 .2.1 基本定律028 .2.2 重要规则029 .3 逻辑函数表达式的形式与变换030 .3.1 逻辑函数表达式的基本形式031 .3.2 逻辑函数表达式的标准形式032 .3.3 逻辑函数表达式的转换033 .4 逻辑函数的化简034 .4.1 代数化简法035 .4.2 卡诺图化简法036 .4.3 包含无关项的逻辑函数的化简037 .4.4 多输出逻辑函数的化简038 .5 本章小结039 .6 习题040 集成门电路041 .1 概述042 .2 正逻辑和负逻辑043 .3 分立元件门电路044 .3.1 与门045 .3.2 或门046 .3.3 非门047 .4.1 TTL与非门048 .4.2 TTL逻辑门的外特性049 .4.3 集电极开路输出门(OC门)050 .4.4 三态输出门(TS门)051 .5 CMOS集成逻辑门电路052 .5.1 CMOS反相器(非门)053 .5.2 CMOS与非门054 .5.3 CMOS或非门055 .5.4 CMOS三态门056 .5.5 CMOS漏极开路输出门(OD门)057 .5.6 CMOS传输门058 .6.1 用TTL门驱动CMOS门059 .6.2 用CMOS门驱动TTL门060 .7 本章小结061 .8 习题062 组合逻辑电路063 .1 概述064 .2 组合逻辑电路的分析065 .2.1 组合电路的分析步骤066 .2.2 组合电路的分析举例067 .3 组合逻辑电路的设计068 .3.1 组合电路的设计步骤069 .3.2 组合电路的设计举例070 .4 经典逻辑运算电路071 .4.1 半加器072 .4.2 全加器073 .4.3 全减器074 .5 代码转化电路075 .5.1 代码转化电路原理分析076 .5.2 代码转化电路的应用077 .6 数值比较电路078 .6.1 1位数值比较器079 .6.2 4位数值比较器080 .6.3 集成比较器的应用081 .7 编码器和译码器082 .7.1 编码器电路原理分析083 .7.2 编码器的应用084 .7.3 译码器电路原理分析085 .7.4 译码器的应用086 .8 数据选择器和数据分配器087 .8.1 数据选择器原理分析088 .8.2 数据选择器的应用089 .8.3 数据分配器原理分析090 .8.4 数据分配器的应用091 .9 竞争和冒险092 .9.1 竞争和冒险现象093 .9.2 险象的判定094 .9.3 险象的消除和减弱095 .10 组合逻辑电路设计的优化问题096 .11 本章小结097 .12 习题098 触发器099 .1 概述100 .1.1 触发器的电路结构和特点101 .1.2 触发器的逻辑功能和分类102 .2 RS触发器103 .2.1 用与非门构成的基本RS触发器104 .2.2 用或非门构成的基本RS触发器105 .2.3 钟控触发器(锁存器)106 .2.4 钟控RS触发器107 .2.5 主从RS触发器108 .3.1 钟控(电平型)D触发器109 .3.2 边沿(维持-阻塞)D触发器110 .3.3 集成D触发器111 .4.1 主从JK触发器112 .4.2 边沿JK触发器113 .4.3 集成JK触发器114 .5.1 T触发器115 .5.2 T′触发器(翻转触发器)116 .6.1 触发器的静态参数117 .6.2 触发器的动态参数118 .7 各类触发器的相互转换119 .7.1 JK触发器转换为D、T、T′和RS触发器120 .7.2 D触发器转换为JK、T、T′和RS触发器121 .8 触发器的应用122 .8.1 消颤开关123 .8.2 分频和双相时钟的产生124 .8.3 异步脉冲同步化125 .9 本章小结126 .10 习题127 同步时序逻辑电路128 .1 概述129 .2 时序逻辑电路的结构和类型130 .2.1 时序逻辑电路的结构和特点131 .2.2 时序逻辑电路的分类132 .3 同步时序逻辑电路的分析133 .3.1 时序逻辑电路的表示方法134 .3.2 分析方法和步骤135 .3.3 分析举例136 .4 同步时序逻辑电路的设计137 .4.1 设计方法和步骤138 .4.2 状态图和状态表139 .4.3 状态化简方法140 .4.4 状态分配及编码141 .4.5 同步时序电路设计举例142 .5 典型同步时序逻辑电路的设计143 .5.1 计数器144 .5.2 十进制计数器145 .5.3 寄存器146 .5.4 移位寄存器型计数器147 .6.1 集成计数器及其应用148 .6.2 集成寄存器及其应用149 .7 本章小结150 .8 习题151 异步时序逻辑电路152 .1 异步时序逻辑电路的分类及特点153 .2 脉冲异步时序逻辑电路154 .2.1 脉冲异步时序逻辑电路的分析155 .2.2 脉冲异步时序逻辑电路的设计156 .3 电平异步时序逻辑电路157 .3.1 电平异步时序逻辑电路的分析158 .3.2 电平异步时序逻辑电路中的竞争与险象159 .3.3 电平异步时序逻辑电路的设计160 .4 异步计数器的原理与应用161 .5 本章小结162 .6 习题163 硬件描述语言Verilog HDL164 .1 Verilog HDL语言概述165 .2.1 标识符166 .2.2 数值和常数167 .2.3 数据类型168 .2.4 Verilog HDL的基本结构169 .3 Verilog HDL的操作符170 .3.1 算术操作符171 .3.2 关系操作符172 .3.3 等价操作符173 .3.4 位操作符174 .3.5 逻辑操作符175 .3.6 缩减操作符176 .3.7 移位操作符177 .3.8 条件操作符178 .3.9 拼接和复制操作符179 .4 基本逻辑门电路的Verilog HDL180 .4.1 与门的Verilog HDL描述181 .4.2 或门的Verilog HDL描述182 .4.3 非门的Verilog HDL描述183 .4.4 与非门的Verilog HDL描述184 .4.5 或非门的Verilog HDL描述185 .4.6 缓冲器电路的Verilog HDL描述186 .4.7 与或非门的Verilog HDL描述187 .5 Verilog HDL的描述方式188 .5.1 门级描述189 .5.2 数据流级描述190 .5.3 行为级描述191 .6 组合逻辑电路的Verilog HDL实现192 .6.1 数值比较器193 .6.2 编码器194 .6.3 译码器195 .7 触发器的Verilog HDL实现196 .7.1 维持-阻塞D触发器197 .7.2 集成D触发器198 .7.3 边沿型JK触发器199 .7.4 集成JK触发器200 .8 时序逻辑电路的Verilog HDL实现201 .8.1 简单时序逻辑电路202 .8.2 复杂时序逻辑电路203 .9 较复杂的电路设计实践204 .10 本章小结205 .11 习题206 脉冲波形的产生与整形207 .1 概述208 .2 555定时器209 .2.1 555定时器的内部结构210 .2.2 555定时器的基本功能211 .3 用555定时器构成的自激多谐振荡器212 .3.1 电路结构213 .3.2 工作原理214 .4 用逻辑门构成的自激多谐振荡器215 .5 石英晶体振荡器216 .6 单稳态触发器217 .6.1 用555定时器构成的单稳态触发器218 .6.2 集成单稳态触发器219 .6.3 单稳态触发器的应用220 .7 施密特触发器221 .7.1 用555定时器构成的施密特触发器222 .7.2 施密特触发器的应用223 .8 习题224 参考文献
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